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標題: [硬件] AMD 16 Core ThreadRipper w/64 PCIe Lanes This Summer, Epyc Launching June 20th [打印本頁]

作者: qcmadness 時間: 2017-6-1 00:30 標題: AMD 16 Core ThreadRipper w/64 PCIe Lanes This Summer, Epyc Launching June 20th

http://www.anandtech.com/show/11 ... anes-epyc-june-20th
http://www.tomshardware.com/news/amd-threadripper-vega-pcie-lanes,34581.html

作者: Sandbo 時間: 2017-6-2 08:23

32 core on June 20th, I can see it replacing a lot of suddenly obsolete Intel servers.

作者: XT 時間: 2017-6-2 20:39

Epyc 個走線 design 同 Ryzen 9 唔同...

作者: qcmadness 時間: 2017-6-2 21:01

引用:

原帖由 XT 於 2017-6-2 20:39 發表
Epyc 個走線 design 同 Ryzen 9 唔同...

source?

作者: XT 時間: 2017-6-2 21:18

引用:

原帖由 qcmadness 於 2017-6-2 21:01 發表

source?

作者: qcmadness 時間: 2017-6-2 21:20

咪又係用Infinic Fabirc / GMI link

作者: tat0801 時間: 2017-6-2 21:58

Intel 都推天價E5 i9
我都好想睇下之後點發展

作者: Sandbo 時間: 2017-6-2 22:56

Judging from the diagram, I wonder if there will be any extra delay going from say top left to bottom right.
Maybe they should implement a cross at the center?

作者: qcmadness 時間: 2017-6-2 23:06

引用:

原帖由 Sandbo 於 2017-6-2 22:56 發表
Judging from the diagram, I wonder if there will be any extra delay going from say top left to bottom right.
Maybe they should implement a cross at the center?

Each Zeppelin has only 2 GMI link.

作者: XT 時間: 2017-6-3 23:59

引用:

原帖由 qcmadness 於 2017-6-2 21:20 發表
咪又係用Infinic Fabirc / GMI link

粒die封裝方式唔同，唔知仲有冇其他野

作者: BlackBird 時間: 2017-6-4 00:30

引用:

原帖由 XT 於 2017-6-3 23:59 發表

粒die封裝方式唔同，唔知仲有冇其他野

因為naples係8channel(說穿了2channelx4dies)

作者: XT 時間: 2017-6-4 00:45

引用:

原帖由 BlackBird 於 2017-6-4 00:30 發表

因為naples係8channel(說穿了2channelx4dies)

哦... 原來係咁

octa-channel係咩野速度呢

作者: dom 時間: 2017-6-4 18:28

I need to keep on using Intel

作者: tat0801 時間: 2017-6-4 22:37

引用:

原帖由 dom 於 2017-6-4 18:28 發表
I need to keep on using Intel

Use nvidia as well

作者: Sandbo 時間: 2017-6-7 11:03

$849 USD Threadripper 16C/32T,
https://www.techpowerup.com/2341 ... rtedly-cost-usd-849

真係咁平，Intel今次連史都冇得食

[ 本帖最後由 Sandbo 於 2017-6-7 11:43 編輯 ]

作者: tat0801 時間: 2017-6-7 11:19

引用:

原帖由 Sandbo 於 2017-6-7 11:03 發表
$849 USD Thrradripper 16C/32T,
https://www.techpowerup.com/234114/amds-entry-level-16-core-32-thread-threadripper-to-reportedly-cost-usd-849

真係咁平，Intel今次連史都冇得食

成本價

咁大鑊啦，INTEL最唔想做果樣可能都要做

作者: qcmadness 時間: 2017-6-7 11:39

引用:

原帖由 tat0801 於 2017-6-7 11:19 發表

成本價
咁大鑊啦，INTEL最唔想做果樣可能都要做

有排都未到成本價

作者: tat0801 時間: 2017-6-7 13:55

引用:

原帖由 qcmadness 於 2017-6-7 11:39 發表

有排都未到成本價

全世界都要INTEL減價啦，對用家係好好好好事黎

作者: qcmadness 時間: 2017-6-11 13:51

最新消息: 有1條x16可能係x399拉出來

作者: BlackBird 時間: 2017-6-11 17:40

引用:

原帖由 qcmadness 於 2017-6-11 13:51 發表
最新消息: 有1條x16可能係x399拉出來

no
但有條x8會係
其實根本就係換個socket然後所有features跟die count黎乘起

[ 本帖最後由 BlackBird 於 2017-6-11 17:47 編輯 ]

作者: qcmadness 時間: 2017-6-11 18:11

引用:

原帖由 BlackBird 於 2017-6-11 17:40 發表

no
但有條x8會係
其實根本就係換個socket然後所有features跟die count黎乘起

但係 Zeppelin 應該跟2條x16

作者: Puff 時間: 2017-6-11 18:35

引用:

原帖由 BlackBird 於 2017-6-11 17:40 發表

no
但有條x8會係
其實根本就係換個socket然後所有features跟die count黎乘起

threadripper up to 16, cut 到 14/12 都喺兩粒
雖然睇落應該都喺用 naples 個巨形 SP3

[ 本帖最後由 Puff 於 2017-6-11 18:41 編輯 ]

作者: Puff 時間: 2017-6-11 18:36

引用:

原帖由 qcmadness 於 2017-6-11 13:51 發表
最新消息: 有1條x16可能係x399拉出來

segmentation?
大概意思就喺全速 x64 請買 Epyc
好似 AM4 得一條 x16 咁

[ 本帖最後由 Puff 於 2017-6-11 18:39 編輯 ]

作者: BlackBird 時間: 2017-6-12 00:30

引用:

原帖由 qcmadness 於 2017-6-11 18:11 發表

但係 Zeppelin 應該跟2條x16

擺到明一條偷黎做GMI

作者: Puff 時間: 2017-6-12 03:04

引用:

原帖由 BlackBird 於 2017-6-12 00:30 發表

擺到明一條偷黎做GMI

1/2S 32-core Naples 都喺夾埋出 x128
偷唔偷每粒都喺要兩條 x16 off-package
on-package 有幾多就唔知，但兩至三條拎走唔甩 (ring 4s/fully connected)
問題喺幾多 serdes lane 同 data rate

作者: BlackBird 時間: 2017-6-13 23:15

引用:

原帖由 Puff 於 2017-6-12 03:04 發表

1/2S 32-core Naples 都喺夾埋出 x128
偷唔偷每粒都喺要兩條 x16 off-package
on-package 有幾多就唔知，但兩至三條拎走唔甩 (ring 4s/fully connected)
問題喺幾多 serdes lane 同 data rate ...

我比較好奇跨Die會唔會當numa

作者: qcmadness 時間: 2017-6-13 23:17

引用:

原帖由 BlackBird 於 2017-6-13 23:15 發表

我比較好奇跨Die會唔會當numa

2個CCX本來已經有software當numa

作者: Puff 時間: 2017-6-14 02:51

引用:

原帖由 BlackBird 於 2017-6-13 23:15 發表

我比較好奇跨Die會唔會當numa

magny cours 同 interlagos by default 當同一個 node + same-package node memory interleaving
不過 BIOS 可以較

作者: Puff 時間: 2017-6-21 05:29

fully connected on-package MCM optimized links
off-package 10.6 GT/s

作者: qcmadness 時間: 2017-6-21 07:20

Designed as multi-channel IF links

Welcome RAS features

作者: qcmadness 時間: 2017-6-22 20:05

http://www.anandtech.com/show/11 ... d-and-epyc-analysis

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